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Trabalho de Conclusão de Curso (Graduação)
Medidor de produtividade de um motor de britagem primária trifásico (2019)
Pacheco, Ana Luísa Vieira; Cari, Elmer Pablo Tito (Orientador)
Unidade: EESC
Subjects: BRITAGEM, CIRCUITOS INTEGRADOS, EQUIPAMENTOS DE MINERAÇÃO, PRODUTIVIDADE
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ABNT
PACHECO, Ana Luísa Vieira. Medidor de produtividade de um motor de britagem primária trifásico. 2019. Trabalho de Conclusão de Curso (Graduação) – Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos, 2019. Disponível em: https://bdta.abcd.usp.br/directbitstream/9d60c7f9-7e5e-440f-9706-b802ab1e4bcf/Pacheco_AnaLuisa_tcc.pdf. Acesso em: 01 maio 2026.
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Pacheco, A. L. V. (2019). Medidor de produtividade de um motor de britagem primária trifásico (Trabalho de Conclusão de Curso (Graduação). Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/9d60c7f9-7e5e-440f-9706-b802ab1e4bcf/Pacheco_AnaLuisa_tcc.pdf
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Pacheco ALV. Medidor de produtividade de um motor de britagem primária trifásico [Internet]. 2019 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/9d60c7f9-7e5e-440f-9706-b802ab1e4bcf/Pacheco_AnaLuisa_tcc.pdf
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Pacheco ALV. Medidor de produtividade de um motor de britagem primária trifásico [Internet]. 2019 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/9d60c7f9-7e5e-440f-9706-b802ab1e4bcf/Pacheco_AnaLuisa_tcc.pdf
Trabalho de Conclusão de Curso (Graduação)
Desenvolvimento e implementação de processador com arquitetura Harvard em tecnologia CMOS de 0,35µm (2018)
Prearo, Guilherme; Soares Junior, João Navarro (Orientador)
Unidade: EESC E ICMC
Subjects: ARQUITETURA E ORGANIZAÇÃO DE COMPUTADORES, CIRCUITOS INTEGRADOS, HARDWARE
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PREARO, Guilherme. Desenvolvimento e implementação de processador com arquitetura Harvard em tecnologia CMOS de 0,35µm. 2018. Trabalho de Conclusão de Curso (Graduação) – , Universidade de São Paulo, São Carlos, 2018. Disponível em: https://bdta.abcd.usp.br/directbitstream/d7228408-d06f-4212-b642-7dbca934a64e/Prearo_Guilherme_tcc.pdf. Acesso em: 01 maio 2026.
APA
Prearo, G. (2018). Desenvolvimento e implementação de processador com arquitetura Harvard em tecnologia CMOS de 0,35µm (Trabalho de Conclusão de Curso (Graduação). , Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/d7228408-d06f-4212-b642-7dbca934a64e/Prearo_Guilherme_tcc.pdf
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Prearo G. Desenvolvimento e implementação de processador com arquitetura Harvard em tecnologia CMOS de 0,35µm [Internet]. 2018 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/d7228408-d06f-4212-b642-7dbca934a64e/Prearo_Guilherme_tcc.pdf
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Prearo G. Desenvolvimento e implementação de processador com arquitetura Harvard em tecnologia CMOS de 0,35µm [Internet]. 2018 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/d7228408-d06f-4212-b642-7dbca934a64e/Prearo_Guilherme_tcc.pdf
Trabalho de Conclusão de Curso (Graduação)
Implementação em Hardware de uma Rede Neural WISARD (2012)
Rossales, Isabela Rodrigues do Prado; Soares Junior, João Navarro (Orientador)
Unidade: EESC E ICMC
Subjects: CIRCUITOS FPGA, CIRCUITOS INTEGRADOS, HARDWARE, REDES NEURAIS
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ROSSALES, Isabela Rodrigues do Prado. Implementação em Hardware de uma Rede Neural WISARD. 2012. Trabalho de Conclusão de Curso (Graduação) – , Universidade de São Paulo, São Carlos, 2012. Disponível em: https://bdta.abcd.usp.br/directbitstream/f9ed4b3d-d15c-4248-8f66-f4da14c3fe2e/Rossales_Isabela_Rodrigues_do_Prado.pdf. Acesso em: 01 maio 2026.
APA
Rossales, I. R. do P. (2012). Implementação em Hardware de uma Rede Neural WISARD (Trabalho de Conclusão de Curso (Graduação). , Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/f9ed4b3d-d15c-4248-8f66-f4da14c3fe2e/Rossales_Isabela_Rodrigues_do_Prado.pdf
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Rossales IR do P. Implementação em Hardware de uma Rede Neural WISARD [Internet]. 2012 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/f9ed4b3d-d15c-4248-8f66-f4da14c3fe2e/Rossales_Isabela_Rodrigues_do_Prado.pdf
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Rossales IR do P. Implementação em Hardware de uma Rede Neural WISARD [Internet]. 2012 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/f9ed4b3d-d15c-4248-8f66-f4da14c3fe2e/Rossales_Isabela_Rodrigues_do_Prado.pdf
Trabalho de Conclusão de Curso (Graduação)
Unidade de condicionamento de sinais aplicada à plataforma PC104 focada ao desenvolvimento e execução de funções de proteção em sistemas elétricos (2012)
Souza, Gustavo Pereira de; Vieira Júnior, José Carlos de Melo (Orientador)
Unidade: EESC
Subjects: CIRCUITOS ELETRÔNICOS, CIRCUITOS INTEGRADOS, RELÉS, SENSOR
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SOUZA, Gustavo Pereira de. Unidade de condicionamento de sinais aplicada à plataforma PC104 focada ao desenvolvimento e execução de funções de proteção em sistemas elétricos. 2012. Trabalho de Conclusão de Curso (Graduação) – Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos, 2012. Disponível em: https://bdta.abcd.usp.br/directbitstream/f833879b-7837-4d70-a3de-c4934141552e/Souza_Gustavo_Pereira_de.pdf. Acesso em: 01 maio 2026.
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Souza, G. P. de. (2012). Unidade de condicionamento de sinais aplicada à plataforma PC104 focada ao desenvolvimento e execução de funções de proteção em sistemas elétricos (Trabalho de Conclusão de Curso (Graduação). Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/f833879b-7837-4d70-a3de-c4934141552e/Souza_Gustavo_Pereira_de.pdf
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Souza GP de. Unidade de condicionamento de sinais aplicada à plataforma PC104 focada ao desenvolvimento e execução de funções de proteção em sistemas elétricos [Internet]. 2012 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/f833879b-7837-4d70-a3de-c4934141552e/Souza_Gustavo_Pereira_de.pdf
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Souza GP de. Unidade de condicionamento de sinais aplicada à plataforma PC104 focada ao desenvolvimento e execução de funções de proteção em sistemas elétricos [Internet]. 2012 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/f833879b-7837-4d70-a3de-c4934141552e/Souza_Gustavo_Pereira_de.pdf
Trabalho de Conclusão de Curso (Graduação)
Dimerização de um reator eletrônico de lâmpadas T5 utilizando o CI L6574 (2010)
Oliveira, Leonardo de; Aguiar, Manoel Luis de (Orientador)
Unidade: EESC
Subjects: CIRCUITOS ELETRÔNICOS, CIRCUITOS INTEGRADOS
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OLIVEIRA, Leonardo de. Dimerização de um reator eletrônico de lâmpadas T5 utilizando o CI L6574. 2010. Trabalho de Conclusão de Curso (Graduação) – Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos, 2010. Disponível em: https://bdta.abcd.usp.br/directbitstream/6ef91a78-21ec-42cb-8a1d-04287d3a7266/Oliveira_Leonardo_de.pdf. Acesso em: 01 maio 2026.
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Oliveira, L. de. (2010). Dimerização de um reator eletrônico de lâmpadas T5 utilizando o CI L6574 (Trabalho de Conclusão de Curso (Graduação). Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/6ef91a78-21ec-42cb-8a1d-04287d3a7266/Oliveira_Leonardo_de.pdf
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Oliveira L de. Dimerização de um reator eletrônico de lâmpadas T5 utilizando o CI L6574 [Internet]. 2010 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/6ef91a78-21ec-42cb-8a1d-04287d3a7266/Oliveira_Leonardo_de.pdf
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Oliveira L de. Dimerização de um reator eletrônico de lâmpadas T5 utilizando o CI L6574 [Internet]. 2010 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/6ef91a78-21ec-42cb-8a1d-04287d3a7266/Oliveira_Leonardo_de.pdf
Trabalho de Conclusão de Curso (Graduação)
Uma ferramenta computacional para a geração automática de símbolos e esquemáticos de componentes eletrônicos (2010)
Prado, Marcelo Loyo; Aguiar, Manoel Luis de (Orientador)
Unidade: EESC
Subjects: CIRCUITOS INTEGRADOS, LINGUAGEM DE PROGRAMAÇÃO
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PRADO, Marcelo Loyo. Uma ferramenta computacional para a geração automática de símbolos e esquemáticos de componentes eletrônicos. 2010. Trabalho de Conclusão de Curso (Graduação) – Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos, 2010. Disponível em: https://bdta.abcd.usp.br/directbitstream/0d36e840-7091-4f94-b2d3-d686424680c5/Prado_Marcelo_Loyo.pdf. Acesso em: 01 maio 2026.
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Prado, M. L. (2010). Uma ferramenta computacional para a geração automática de símbolos e esquemáticos de componentes eletrônicos (Trabalho de Conclusão de Curso (Graduação). Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/0d36e840-7091-4f94-b2d3-d686424680c5/Prado_Marcelo_Loyo.pdf
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Prado ML. Uma ferramenta computacional para a geração automática de símbolos e esquemáticos de componentes eletrônicos [Internet]. 2010 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/0d36e840-7091-4f94-b2d3-d686424680c5/Prado_Marcelo_Loyo.pdf
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Prado ML. Uma ferramenta computacional para a geração automática de símbolos e esquemáticos de componentes eletrônicos [Internet]. 2010 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/0d36e840-7091-4f94-b2d3-d686424680c5/Prado_Marcelo_Loyo.pdf
Trabalho de Conclusão de Curso (Graduação)
Placa de desenvolvimento de sistemas eletrônicos baseados em ARM e FPGA com interfaces Ethernet e GSM (2007)
Passos Junior, Gesner Orlandi; Monteiro, José Roberto Boffino de Almeida (Orientador)
Unidade: EESC
Subjects: CIRCUITOS INTEGRADOS, HARDWARE, MICROPROCESSADORES, REDES LOCAIS DE COMPUTADORES
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ABNT
PASSOS JUNIOR, Gesner Orlandi. Placa de desenvolvimento de sistemas eletrônicos baseados em ARM e FPGA com interfaces Ethernet e GSM. 2007. Trabalho de Conclusão de Curso (Graduação) – Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos, 2007. Disponível em: https://bdta.abcd.usp.br/directbitstream/d42f1558-5762-495d-bdbf-38276ed9c24c/Passos_Junior_Gesner_Orlandi.pdf. Acesso em: 01 maio 2026.
APA
Passos Junior, G. O. (2007). Placa de desenvolvimento de sistemas eletrônicos baseados em ARM e FPGA com interfaces Ethernet e GSM (Trabalho de Conclusão de Curso (Graduação). Escola de Engenharia de São Carlos, Universidade de São Paulo, São Carlos. Recuperado de https://bdta.abcd.usp.br/directbitstream/d42f1558-5762-495d-bdbf-38276ed9c24c/Passos_Junior_Gesner_Orlandi.pdf
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Passos Junior GO. Placa de desenvolvimento de sistemas eletrônicos baseados em ARM e FPGA com interfaces Ethernet e GSM [Internet]. 2007 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/d42f1558-5762-495d-bdbf-38276ed9c24c/Passos_Junior_Gesner_Orlandi.pdf
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Passos Junior GO. Placa de desenvolvimento de sistemas eletrônicos baseados em ARM e FPGA com interfaces Ethernet e GSM [Internet]. 2007 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/d42f1558-5762-495d-bdbf-38276ed9c24c/Passos_Junior_Gesner_Orlandi.pdf
Trabalho de Conclusão de Curso (Graduação)
Estudo da integração entre sistemas de elevadores e sistema de circuito fechado de televisão em edifícios inteligentes (2003)
Boni, Eduardo; Yoshinaga, Hugo; Moscato, Lucas Antonio (coord) ; Miyagi, Paulo Eigi (Orientador) ; Bastidas Gustin, Gladys Deifan (coorient)
Unidade: EP
Subjects: ELEVADORES (CIRCULAÇÃO), INTEGRAÇÃO DE FUNÇÕES ELEMENTARES, CIRCUITOS INTEGRADOS, EDIFÍCIOS INTELIGENTES, SISTEMAS PREDIAIS
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BONI, Eduardo e YOSHINAGA, Hugo. Estudo da integração entre sistemas de elevadores e sistema de circuito fechado de televisão em edifícios inteligentes. 2003. Trabalho de Conclusão de Curso (Graduação) – Escola Politécnica, Universidade de São Paulo, São Paulo, 2003. Disponível em: https://bdta.abcd.usp.br/directbitstream/d589f4d7-c580-43f4-aca0-db3c331252e2/Eduardo%20Boni.pdf. Acesso em: 01 maio 2026.
APA
Boni, E., & Yoshinaga, H. (2003). Estudo da integração entre sistemas de elevadores e sistema de circuito fechado de televisão em edifícios inteligentes (Trabalho de Conclusão de Curso (Graduação). Escola Politécnica, Universidade de São Paulo, São Paulo. Recuperado de https://bdta.abcd.usp.br/directbitstream/d589f4d7-c580-43f4-aca0-db3c331252e2/Eduardo%20Boni.pdf
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Boni E, Yoshinaga H. Estudo da integração entre sistemas de elevadores e sistema de circuito fechado de televisão em edifícios inteligentes [Internet]. 2003 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/d589f4d7-c580-43f4-aca0-db3c331252e2/Eduardo%20Boni.pdf
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Boni E, Yoshinaga H. Estudo da integração entre sistemas de elevadores e sistema de circuito fechado de televisão em edifícios inteligentes [Internet]. 2003 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/d589f4d7-c580-43f4-aca0-db3c331252e2/Eduardo%20Boni.pdf
Trabalho de Conclusão de Curso (Graduação)
Modelos de negócios de produção e condições de inserção da indústria de circuitos integrados no Brasil (2002)
Shintate, José Henrique; Amato Neto, João (Orientador)
Unidade: EP
Subjects: CIRCUITOS INTEGRADOS, PRODUÇÃO (ECONOMIA)
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SHINTATE, José Henrique. Modelos de negócios de produção e condições de inserção da indústria de circuitos integrados no Brasil. 2002. Trabalho de Conclusão de Curso (Graduação) – Escola Politécnica, Universidade de São Paulo, São Paulo, 2002. Disponível em: https://bdta.abcd.usp.br/directbitstream/abcc3085-da16-4114-aa0f-23fea3a59b40/Jose_Henrique_Shintate.pdf. Acesso em: 01 maio 2026.
APA
Shintate, J. H. (2002). Modelos de negócios de produção e condições de inserção da indústria de circuitos integrados no Brasil (Trabalho de Conclusão de Curso (Graduação). Escola Politécnica, Universidade de São Paulo, São Paulo. Recuperado de https://bdta.abcd.usp.br/directbitstream/abcc3085-da16-4114-aa0f-23fea3a59b40/Jose_Henrique_Shintate.pdf
NLM
Shintate JH. Modelos de negócios de produção e condições de inserção da indústria de circuitos integrados no Brasil [Internet]. 2002 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/abcc3085-da16-4114-aa0f-23fea3a59b40/Jose_Henrique_Shintate.pdf
Vancouver
Shintate JH. Modelos de negócios de produção e condições de inserção da indústria de circuitos integrados no Brasil [Internet]. 2002 ;[citado 2026 maio 01 ] Available from: https://bdta.abcd.usp.br/directbitstream/abcc3085-da16-4114-aa0f-23fea3a59b40/Jose_Henrique_Shintate.pdf

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